ASCENT: Amplifying Power Side-Channel Resilience via Learning & Monte-Carlo Tree Search

Fuente: arXiv

Gespeichert in:

Bibliographische Detailangaben
Hauptverfasser:	Bhandari, Jitendra, Chowdhury, Animesh Basak, Nabeel, Mohammed, Sinanoglu, Ozgur, Garg, Siddharth, Karri, Ramesh, Knechtel, Johann
Format:	Preprint
Veröffentlicht:	2024
Schlagworte:	Cryptography and Security Machine Learning
Online-Zugang:	Acceder al recurso
Tags:	Tag hinzufügen Keine Tags, Fügen Sie den ersten Tag hinzu!

Ähnliche Einträge

Lightweight Countermeasures Against Static Power Side-Channel Attacks
von: Bhandari, Jitendra, et al.
Veröffentlicht: (2024)

LLMs for Secure Hardware Design and Related Problems: Opportunities and Challenges
von: Knechtel, Johann, et al.
Veröffentlicht: (2026)

LLM4PQC - Accurate and Efficient Synthesis of PQC Cores by Feedback-Driven LLMs
von: Perera, Buddhi, et al.
Veröffentlicht: (2026)

RTL-Breaker: Assessing the Security of LLMs against Backdoor Attacks on HDL Code Generation
von: Mankali, Lakshmi Likhitha, et al.
Veröffentlicht: (2024)

VeriContaminated: Assessing LLM-Driven Verilog Coding for Data Contamination
von: Wang, Zeng, et al.
Veröffentlicht: (2025)

VeriLeaky: Navigating IP Protection vs Utility in Fine-Tuning for LLM-Driven Verilog Coding
von: Wang, Zeng, et al.
Veröffentlicht: (2025)

SALAD: Systematic Assessment of Machine Unlearning on LLM-Aided Hardware Design
von: Wang, Zeng, et al.
Veröffentlicht: (2025)

TrojanLoC: LLM-based Framework for RTL Trojan Localization
von: Xiao, Weihua, et al.
Veröffentlicht: (2025)

LockForge: Automating Paper-to-Code for Logic Locking with Multi-Agent Reasoning LLMs
von: Saha, Akashdeep, et al.
Veröffentlicht: (2025)

LLM-Aided Testbench Generation and Bug Detection for Finite-State Machines
von: Bhandari, Jitendra, et al.
Veröffentlicht: (2024)

NetDeTox: Adversarial and Efficient Evasion of Hardware-Security GNNs via RL-LLM Orchestration
von: Wang, Zeng, et al.
Veröffentlicht: (2025)

VeriCWEty: Embedding enabled Line-Level CWE Detection in Verilog
von: Roy, Prithwish Basu, et al.
Veröffentlicht: (2026)

HarmChip: Evaluating Hardware Security Centric LLM Safety via Jailbreak Benchmarking
von: Wang, Zeng, et al.
Veröffentlicht: (2026)

TrojanGYM: A Detector-in-the-Loop LLM for Adaptive RTL Hardware Trojan Insertion
von: Sreekumar, Saideep, et al.
Veröffentlicht: (2026)

LLMs and the Future of Chip Design: Unveiling Security Risks and Building Trust
von: Wang, Zeng, et al.
Veröffentlicht: (2024)

Targeted Wearout Attacks in Microprocessor Cores
von: Mashburn, Joshua, et al.
Veröffentlicht: (2025)

SENTAUR: Security EnhaNced Trojan Assessment Using LLMs Against Undesirable Revisions
von: Bhandari, Jitendra, et al.
Veröffentlicht: (2024)

SaMOSA: Sandbox for Malware Orchestration and Side-Channel Analysis
von: Udeshi, Meet, et al.
Veröffentlicht: (2025)

VeriLoC: Line-of-Code Level Prediction of Hardware Design Quality from Verilog Code
von: Hemadri, Raghu Vamshi, et al.
Veröffentlicht: (2025)

Retrieval-Guided Reinforcement Learning for Boolean Circuit Minimization
von: Chowdhury, Animesh Basak, et al.
Veröffentlicht: (2024)

GUIDE: GenAI Units In Digital Design Education
von: Xiao, Weihua, et al.
Veröffentlicht: (2026)

Logic Encryption: This Time for Real
von: Karn, Rupesh Raj, et al.
Veröffentlicht: (2025)

Veritas: Deterministic Verilog Code Synthesis from LLM-Generated Conjunctive Normal Form
von: Roy, Prithwish Basu, et al.
Veröffentlicht: (2025)

An Empirical Evaluation of LLMs for Solving Offensive Security Challenges
von: Shao, Minghao, et al.
Veröffentlicht: (2024)

Configuration Over Selection: Hyperparameter Sensitivity Exceeds Model Differences in Open-Source LLMs for RTL Generation
von: Shao, Minghao, et al.
Veröffentlicht: (2026)

Synthesis-in-the-Loop Evaluation of LLMs for RTL Generation: Quality, Reliability, and Failure Modes
von: Fu, Weimin, et al.
Veröffentlicht: (2026)

From Natural Language to Silicon: The Representation Bottleneck in LLM Hardware Design
von: Fu, Weimin, et al.
Veröffentlicht: (2026)

Stochastic Training for Side-Channel Resilient AI
von: Dubey, Anuj, et al.
Veröffentlicht: (2025)

Always be Pre-Training: Representation Learning for Network Intrusion Detection with GNNs
von: Gu, Zhengyao, et al.
Veröffentlicht: (2024)

TroLLoc: Logic Locking and Layout Hardening for IC Security Closure against Hardware Trojans
von: Wang, Fangzhou, et al.
Veröffentlicht: (2024)

Need for zkSpeed: Accelerating HyperPlonk for Zero-Knowledge Proofs
von: Daftardar, Alhad, et al.
Veröffentlicht: (2025)

Masala-CHAI: A Large-Scale SPICE Netlist Dataset for Analog Circuits by Harnessing AI
von: Bhandari, Jitendra, et al.
Veröffentlicht: (2024)

CoFHEE: A Co-processor for Fully Homomorphic Encryption Execution (Extended Version)
von: Nabeel, Mohammed, et al.
Veröffentlicht: (2022)

ARIANNA: An Automatic Design Flow for Fabric Customization and eFPGA Redaction
von: Collini, Luca, et al.
Veröffentlicht: (2025)

Scalable Test Generation to Trigger Rare Targets in High-Level Synthesizable IPs for Cloud FPGAs
von: Debnath, Mukta, et al.
Veröffentlicht: (2024)

Enabling Deep Visibility into VxWorks-Based Embedded Controllers in Cyber-Physical Systems for Anomaly Detection
von: Krishnamurthy, Prashanth, et al.
Veröffentlicht: (2025)

SCAMPER -- Synchrophasor Covert chAnnel for Malicious and Protective ERrands
von: Krishnamurthy, Prashanth, et al.
Veröffentlicht: (2025)

Real-Time Multi-Modal Subcomponent-Level Measurements for Trustworthy System Monitoring and Malware Detection
von: Khorrami, Farshad, et al.
Veröffentlicht: (2025)

Make Every Move Count: LLM-based High-Quality RTL Code Generation Using MCTS
von: DeLorenzo, Matthew, et al.
Veröffentlicht: (2024)

Exploring Power Side-Channel Challenges in Embedded Systems Security
von: Narimani, Pouya, et al.
Veröffentlicht: (2024)