Non-Overlapping Placement of Macro Cells based on Reinforcement Learning in Chip Design
Fuente:
arXiv
Salvato in:
| Autori principali: | Yu, Tao, Gao, Peng, Wang, Fei, Yuan, Ru-Yue |
|---|---|
| Natura: | Preprint |
| Pubblicazione: |
2024
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