Revisiting VerilogEval: A Year of Improvements in Large-Language Models for Hardware Code Generation
Fuente:
arXiv
Gespeichert in:
| Hauptverfasser: | Pinckney, Nathaniel, Batten, Christopher, Liu, Mingjie, Ren, Haoxing, Khailany, Brucek |
|---|---|
| Format: | Preprint |
| Veröffentlicht: |
2024
|
| Schlagworte: | |
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