HiVeGen -- Hierarchical LLM-based Verilog Generation for Scalable Chip Design

Fuente: arXiv
Salvato in:
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Autori principali: Tang, Jinwei, Qin, Jiayin, Thorat, Kiran, Zhu-Tian, Chen, Cao, Yu, Yang, Zhao, Ding, Caiwen
Natura: Preprint
Pubblicazione: 2024
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