AIRCHITECT v2: Learning the Hardware Accelerator Design Space through Unified Representations
Fuente:
arXiv
Salvato in:
| Autori principali: | Seo, Jamin, Ramachandran, Akshat, Chuang, Yu-Chuan, Itagi, Anirudh, Krishna, Tushar |
|---|---|
| Natura: | Preprint |
| Pubblicazione: |
2025
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