Salvato in:
| Autori principali: | Ma, Ruiyang, Zhou, Yunhao, Wang, Yipeng, Liu, Yi, Shi, Zhengyuan, Zheng, Ziyang, Chen, Kexin, He, Zhiqiang, Yan, Lingwei, Chen, Gang, Xu, Qiang, Luo, Guojie |
|---|---|
| Natura: | Preprint |
| Pubblicazione: |
2025
|
| Soggetti: | |
| Accesso online: | https://arxiv.org/abs/2511.09593 |
| Tags: |
Aggiungi Tag
Nessun Tag, puoi essere il primo ad aggiungerne!!
|
Documenti analoghi
DeepRTL2: A Versatile Model for RTL-Related Tasks
di: Liu, Yi, et al.
Pubblicazione: (2025)
di: Liu, Yi, et al.
Pubblicazione: (2025)
DeepRTL: Bridging Verilog Understanding and Generation with a Unified Representation Model
di: Liu, Yi, et al.
Pubblicazione: (2025)
di: Liu, Yi, et al.
Pubblicazione: (2025)
DeepCircuitX: A Comprehensive Repository-Level Dataset for RTL Code Understanding, Generation, and PPA Analysis
di: Li, Zeju, et al.
Pubblicazione: (2025)
di: Li, Zeju, et al.
Pubblicazione: (2025)
FormalRTL: Verified RTL Synthesis at Scale
di: Li, Kezhi, et al.
Pubblicazione: (2026)
di: Li, Kezhi, et al.
Pubblicazione: (2026)
CktEvo: Repository-Level RTL Code Benchmark for Design Evolution
di: Shi, Zhengyuan, et al.
Pubblicazione: (2026)
di: Shi, Zhengyuan, et al.
Pubblicazione: (2026)
PipeRTL: Timing-Aware Pipeline Optimization at IR-Level for RTL Generation
di: Yin, Shuo, et al.
Pubblicazione: (2026)
di: Yin, Shuo, et al.
Pubblicazione: (2026)
DeepSeq2: Enhanced Sequential Circuit Learning with Disentangled Representations
di: Khan, Sadaf, et al.
Pubblicazione: (2024)
di: Khan, Sadaf, et al.
Pubblicazione: (2024)
IncreRTL: Traceability-Guided Incremental RTL Generation under Requirement Evolution
di: Chen, Luanrong, et al.
Pubblicazione: (2026)
di: Chen, Luanrong, et al.
Pubblicazione: (2026)
RTL-BenchMT: Dynamic Maintenance of RTL Generation Benchmark Through Agent-Assisted Analysis and Revision
di: Wang, Jing, et al.
Pubblicazione: (2026)
di: Wang, Jing, et al.
Pubblicazione: (2026)
RTL++: Graph-enhanced LLM for RTL Code Generation
di: Akyash, Mohammad, et al.
Pubblicazione: (2025)
di: Akyash, Mohammad, et al.
Pubblicazione: (2025)
DeepGate3: Towards Scalable Circuit Representation Learning
di: Shi, Zhengyuan, et al.
Pubblicazione: (2024)
di: Shi, Zhengyuan, et al.
Pubblicazione: (2024)
Dr. RTL: Autonomous Agentic RTL Optimization through Tool-Grounded Self-Improvement
di: Fang, Wenji, et al.
Pubblicazione: (2026)
di: Fang, Wenji, et al.
Pubblicazione: (2026)
Alignment Unlocks Complementarity: A Framework for Multiview Circuit Representation Learning
di: Shi, Zhengyuan, et al.
Pubblicazione: (2025)
di: Shi, Zhengyuan, et al.
Pubblicazione: (2025)
VeriRAG: A Retrieval-Augmented Framework for Automated RTL Testability Repair
di: Qi, Haomin, et al.
Pubblicazione: (2025)
di: Qi, Haomin, et al.
Pubblicazione: (2025)
ACE-RTL: When Agentic Context Evolution Meets RTL-Specialized LLMs
di: Deng, Chenhui, et al.
Pubblicazione: (2026)
di: Deng, Chenhui, et al.
Pubblicazione: (2026)
Beyond Tokens: Enhancing RTL Quality Estimation via Structural Graph Learning
di: Liu, Yi, et al.
Pubblicazione: (2025)
di: Liu, Yi, et al.
Pubblicazione: (2025)
DeepGate4: Efficient and Effective Representation Learning for Circuit Design at Scale
di: Zheng, Ziyang, et al.
Pubblicazione: (2025)
di: Zheng, Ziyang, et al.
Pubblicazione: (2025)
Circuit-Aware SAT Solving: Guiding CDCL via Conditional Probabilities
di: Zhu, Jiaying, et al.
Pubblicazione: (2025)
di: Zhu, Jiaying, et al.
Pubblicazione: (2025)
DecoRTL: A Run-time Decoding Framework for RTL Code Generation with LLMs
di: Akyash, Mohammad, et al.
Pubblicazione: (2025)
di: Akyash, Mohammad, et al.
Pubblicazione: (2025)
RTL-Repo: A Benchmark for Evaluating LLMs on Large-Scale RTL Design Projects
di: Allam, Ahmed, et al.
Pubblicazione: (2024)
di: Allam, Ahmed, et al.
Pubblicazione: (2024)
OpenLLM-RTL: Open Dataset and Benchmark for LLM-Aided Design RTL Generation
di: Liu, Shang, et al.
Pubblicazione: (2025)
di: Liu, Shang, et al.
Pubblicazione: (2025)
MeltRTL: Multi-Expert LLMs with Inference-time Intervention for RTL Code Generation
di: Mashnoor, Nowfel, et al.
Pubblicazione: (2026)
di: Mashnoor, Nowfel, et al.
Pubblicazione: (2026)
SynCircuit: Automated Generation of New Synthetic RTL Circuits Can Enable Big Data in Circuits
di: Liu, Shang, et al.
Pubblicazione: (2025)
di: Liu, Shang, et al.
Pubblicazione: (2025)
DeepCell: Self-Supervised Multiview Fusion for Circuit Representation Learning
di: Shi, Zhengyuan, et al.
Pubblicazione: (2025)
di: Shi, Zhengyuan, et al.
Pubblicazione: (2025)
ScaleRTL: Scaling LLMs with Reasoning Data and Test-Time Compute for Accurate RTL Code Generation
di: Deng, Chenhui, et al.
Pubblicazione: (2025)
di: Deng, Chenhui, et al.
Pubblicazione: (2025)
RTLSquad: Multi-Agent Based Interpretable RTL Design
di: Wang, Bowei, et al.
Pubblicazione: (2025)
di: Wang, Bowei, et al.
Pubblicazione: (2025)
GSIM: Accelerating RTL Simulation for Large-Scale Designs
di: Chen, Lu, et al.
Pubblicazione: (2025)
di: Chen, Lu, et al.
Pubblicazione: (2025)
SymRTLO: Enhancing RTL Code Optimization with LLMs and Neuron-Inspired Symbolic Reasoning
di: Wang, Yiting, et al.
Pubblicazione: (2025)
di: Wang, Yiting, et al.
Pubblicazione: (2025)
MCP4EDA: LLM-Powered Model Context Protocol RTL-to-GDSII Automation with Backend Aware Synthesis Optimization
di: Wang, Yiting, et al.
Pubblicazione: (2025)
di: Wang, Yiting, et al.
Pubblicazione: (2025)
RTLRewriter: Methodologies for Large Models aided RTL Code Optimization
di: Yao, Xufeng, et al.
Pubblicazione: (2024)
di: Yao, Xufeng, et al.
Pubblicazione: (2024)
CircuitGuard: Mitigating LLM Memorization in RTL Code Generation Against IP Leakage
di: Mashnoor, Nowfel, et al.
Pubblicazione: (2025)
di: Mashnoor, Nowfel, et al.
Pubblicazione: (2025)
R2G: A Multi-View Circuit Graph Benchmark Suite from RTL to GDSII
di: Zhou, Zewei, et al.
Pubblicazione: (2026)
di: Zhou, Zewei, et al.
Pubblicazione: (2026)
RTL Verification for Secure Speculation Using Contract Shadow Logic
di: Tan, Qinhan, et al.
Pubblicazione: (2024)
di: Tan, Qinhan, et al.
Pubblicazione: (2024)
SmaRTLy: RTL Optimization with Logic Inferencing and Structural Rebuilding
di: Li, Chengxi, et al.
Pubblicazione: (2025)
di: Li, Chengxi, et al.
Pubblicazione: (2025)
Automated Multi-Agent Workflows for RTL Design
di: Bhattaram, Amulya, et al.
Pubblicazione: (2025)
di: Bhattaram, Amulya, et al.
Pubblicazione: (2025)
Using LLMs to Facilitate Formal Verification of RTL
di: Orenes-Vera, Marcelo, et al.
Pubblicazione: (2023)
di: Orenes-Vera, Marcelo, et al.
Pubblicazione: (2023)
Parendi: Thousand-Way Parallel RTL Simulation
di: Emami, Mahyar, et al.
Pubblicazione: (2024)
di: Emami, Mahyar, et al.
Pubblicazione: (2024)
INSTILLER: Towards Efficient and Realistic RTL Fuzzing
di: Zhang, Gen, et al.
Pubblicazione: (2024)
di: Zhang, Gen, et al.
Pubblicazione: (2024)
From Language to Logic: Bridging LLMs & Formal Representations for RTL Assertion Generation
di: Mashnoor, Nowfel, et al.
Pubblicazione: (2026)
di: Mashnoor, Nowfel, et al.
Pubblicazione: (2026)
RTLocating: Intent-aware RTL Localization for Hardware Design Iteration
di: Xing, Changwen, et al.
Pubblicazione: (2026)
di: Xing, Changwen, et al.
Pubblicazione: (2026)
Documenti analoghi
-
DeepRTL2: A Versatile Model for RTL-Related Tasks
di: Liu, Yi, et al.
Pubblicazione: (2025) -
DeepRTL: Bridging Verilog Understanding and Generation with a Unified Representation Model
di: Liu, Yi, et al.
Pubblicazione: (2025) -
DeepCircuitX: A Comprehensive Repository-Level Dataset for RTL Code Understanding, Generation, and PPA Analysis
di: Li, Zeju, et al.
Pubblicazione: (2025) -
FormalRTL: Verified RTL Synthesis at Scale
di: Li, Kezhi, et al.
Pubblicazione: (2026) -
CktEvo: Repository-Level RTL Code Benchmark for Design Evolution
di: Shi, Zhengyuan, et al.
Pubblicazione: (2026)