VeriPy -- A New Python-Based Approach for SDR Pipelined/Unrolled Hardware Accelerator Generation

Fuente: arXiv
Salvato in:
Dettagli Bibliografici
Autori principali: Zhao, Yuqin, Ye, Linghui, Xia, Haihang, Seed, Luke, Deng, Tiantai
Natura: Preprint
Pubblicazione: 2025
Soggetti:
Accesso online:
Tags: Aggiungi Tag
Nessun Tag, puoi essere il primo ad aggiungerne!!