AXON: An Automated Netlist Optimization Framework for High-Speed Adders
Fuente:
arXiv
Salvato in:
| Autori principali: | Yang, Tiantian, Ren, Xuanle, Wan, Qingdian, Meng, Qi |
|---|---|
| Natura: | Preprint |
| Pubblicazione: |
2026
|
| Soggetti: | |
| Accesso online: | |
| Tags: |
Aggiungi Tag
Nessun Tag, puoi essere il primo ad aggiungerne!!
|
Documenti analoghi
PrefixAgent: An LLM-Powered Design Framework for Efficient Prefix Adder Optimization
di: Zuo, Dongsheng, et al.
Pubblicazione: (2025)
di: Zuo, Dongsheng, et al.
Pubblicazione: (2025)
Online Alignment and Addition in Multi-Term Floating-Point Adders
di: Alexandridis, Kosmas, et al.
Pubblicazione: (2024)
di: Alexandridis, Kosmas, et al.
Pubblicazione: (2024)
Floating Point HUB Adder for RISC-V Sargantana Processor
di: Bandera, Gerardo, et al.
Pubblicazione: (2024)
di: Bandera, Gerardo, et al.
Pubblicazione: (2024)
Masala-CHAI: A Large-Scale SPICE Netlist Dataset for Analog Circuits by Harnessing AI
di: Bhandari, Jitendra, et al.
Pubblicazione: (2024)
di: Bhandari, Jitendra, et al.
Pubblicazione: (2024)
Orthrus: Dual-Loop Automated Framework for System-Technology Co-Optimization
di: Ren, Yi, et al.
Pubblicazione: (2025)
di: Ren, Yi, et al.
Pubblicazione: (2025)
Fast Bipartitioned Hybrid Adder Utilizing Carry Select and Carry Lookahead Logic
di: Balasubramanian, Padmanabhan, et al.
Pubblicazione: (2024)
di: Balasubramanian, Padmanabhan, et al.
Pubblicazione: (2024)
Double Duty: FPGA Architecture to Enable Concurrent LUT and Adder Chain Usage
di: Pun, Junius, et al.
Pubblicazione: (2025)
di: Pun, Junius, et al.
Pubblicazione: (2025)
Aligning Netlist to Source Code using SynAlign
di: Garg, Sakshi, et al.
Pubblicazione: (2025)
di: Garg, Sakshi, et al.
Pubblicazione: (2025)
There and Back Again: A Netlist's Tale with Much Egraphin'
di: Smith, Gus Henry, et al.
Pubblicazione: (2024)
di: Smith, Gus Henry, et al.
Pubblicazione: (2024)
HALOC-AxA: An Area/-Energy-Efficient Approximate Adder for Image Processing Application
di: Ziad, Hasnain A., et al.
Pubblicazione: (2025)
di: Ziad, Hasnain A., et al.
Pubblicazione: (2025)
FPGA-Based Multiplier with a New Approximate Full Adder for Error-Resilient Applications
di: Ranjbar, Ali, et al.
Pubblicazione: (2025)
di: Ranjbar, Ali, et al.
Pubblicazione: (2025)
ChatHLS: Towards Systematic Design Automation and Optimization for High-Level Synthesis
di: Li, Runkai, et al.
Pubblicazione: (2025)
di: Li, Runkai, et al.
Pubblicazione: (2025)
Novel Optimized Designs of Modulo $2n+1$ Adder for Quantum Computing
di: Gaur, Bhaskar, et al.
Pubblicazione: (2024)
di: Gaur, Bhaskar, et al.
Pubblicazione: (2024)
DOMAC: Differentiable Optimization for High-Speed Multipliers and Multiply-Accumulators
di: Xue, Chenhao, et al.
Pubblicazione: (2025)
di: Xue, Chenhao, et al.
Pubblicazione: (2025)
DE-HNN: An effective neural model for Circuit Netlist representation
di: Luo, Zhishang, et al.
Pubblicazione: (2024)
di: Luo, Zhishang, et al.
Pubblicazione: (2024)
SynFuzz: Leveraging Fuzzing of Netlist to Detect Synthesis Bugs
di: Saravanan, Raghul, et al.
Pubblicazione: (2025)
di: Saravanan, Raghul, et al.
Pubblicazione: (2025)
ATLAS: A Self-Supervised and Cross-Stage Netlist Power Model for Fine-Grained Time-Based Layout Power Analysis
di: Li, Wenkai, et al.
Pubblicazione: (2025)
di: Li, Wenkai, et al.
Pubblicazione: (2025)
Semicustom Frontend VLSI Design and Analysis of a 32-bit Brent-Kung Adder in Cadence Suite
di: Singh, Yashvardhan
Pubblicazione: (2025)
di: Singh, Yashvardhan
Pubblicazione: (2025)
EquivFusion: Unifying Hardware Equivalence Checking from Algorithms to Netlists via MLIR
di: Zhu, Jiaying, et al.
Pubblicazione: (2026)
di: Zhu, Jiaying, et al.
Pubblicazione: (2026)
Novel Efficient Scalable QCA XOR and Full Adder Designs
di: Safaiezadeh, Behrouz, et al.
Pubblicazione: (2023)
di: Safaiezadeh, Behrouz, et al.
Pubblicazione: (2023)
ArtNet: Hierarchical Clustering-Based Artificial Netlist Generator for ML and DTCO Application
di: Kang, Andrew B. Kahng. Seokhyeong, et al.
Pubblicazione: (2025)
di: Kang, Andrew B. Kahng. Seokhyeong, et al.
Pubblicazione: (2025)
VeriRAG: A Retrieval-Augmented Framework for Automated RTL Testability Repair
di: Qi, Haomin, et al.
Pubblicazione: (2025)
di: Qi, Haomin, et al.
Pubblicazione: (2025)
FIFOAdvisor: A DSE Framework for Automated FIFO Sizing of High-Level Synthesis Designs
di: Abi-Karam, Stefan, et al.
Pubblicazione: (2025)
di: Abi-Karam, Stefan, et al.
Pubblicazione: (2025)
Configurable Multi-Port Memory Architecture for High-Speed Data Communication
di: Dhakad, Narendra Singh, et al.
Pubblicazione: (2024)
di: Dhakad, Narendra Singh, et al.
Pubblicazione: (2024)
Noise-Resilient and Reduced Depth Approximate Adders for NISQ Quantum Computing
di: Gaur, Bhaskar, et al.
Pubblicazione: (2024)
di: Gaur, Bhaskar, et al.
Pubblicazione: (2024)
Automated SVA Generation with LLMs
di: Fu, Lik Tung, et al.
Pubblicazione: (2026)
di: Fu, Lik Tung, et al.
Pubblicazione: (2026)
Design of a Reformed Array Logic Binary Multiplier for High-Speed Computations
di: Mohammad, Sakib, et al.
Pubblicazione: (2024)
di: Mohammad, Sakib, et al.
Pubblicazione: (2024)
Schemato -- An LLM for Netlist-to-Schematic Conversion
di: Matsuo, Ryoga, et al.
Pubblicazione: (2024)
di: Matsuo, Ryoga, et al.
Pubblicazione: (2024)
AGON: Automated Design Framework for Customizing Processors from ISA Documents
di: Li, Chongxiao, et al.
Pubblicazione: (2024)
di: Li, Chongxiao, et al.
Pubblicazione: (2024)
PrefixGPT: Prefix Adder Optimization by a Generative Pre-trained Transformer
di: Ding, Ruogu, et al.
Pubblicazione: (2025)
di: Ding, Ruogu, et al.
Pubblicazione: (2025)
CODO: An Automated Compiler for Comprehensive Dataflow Optimization
di: Zhang, Weichuang, et al.
Pubblicazione: (2026)
di: Zhang, Weichuang, et al.
Pubblicazione: (2026)
CellE: Automated Standard Cell Library Extension via Equality Saturation
di: Ren, Yi, et al.
Pubblicazione: (2026)
di: Ren, Yi, et al.
Pubblicazione: (2026)
GenEDA: Towards Generative Netlist Functional Reasoning via Cross-Modal Circuit Encoder-Decoder Alignment
di: Fang, Wenji, et al.
Pubblicazione: (2025)
di: Fang, Wenji, et al.
Pubblicazione: (2025)
NetTAG: A Multimodal RTL-and-Layout-Aligned Netlist Foundation Model via Text-Attributed Graph
di: Fang, Wenji, et al.
Pubblicazione: (2025)
di: Fang, Wenji, et al.
Pubblicazione: (2025)
A Logarithmic Depth Quantum Carry-Lookahead Modulo $(2^n-1)$ Adder
di: Gaur, Bhaskar, et al.
Pubblicazione: (2024)
di: Gaur, Bhaskar, et al.
Pubblicazione: (2024)
Combined power management and congestion control in High-Speed Ethernet-based Networks for Supercomputers and Data Centers
di: de la Rosa, Miguel Sánchez, et al.
Pubblicazione: (2025)
di: de la Rosa, Miguel Sánchez, et al.
Pubblicazione: (2025)
CREATE: Cross-Layer Resilience Characterization and Optimization for Efficient yet Reliable Embodied AI Systems
di: Xie, Tong, et al.
Pubblicazione: (2026)
di: Xie, Tong, et al.
Pubblicazione: (2026)
UFO-MAC: A Unified Framework for Optimization of High-Performance Multipliers and Multiply-Accumulators
di: Zuo, Dongsheng, et al.
Pubblicazione: (2024)
di: Zuo, Dongsheng, et al.
Pubblicazione: (2024)
Extracting TCPIP Headers at High Speed for the Anonymized Network Traffic Graph Challenge
di: Han, Zhaoyang, et al.
Pubblicazione: (2024)
di: Han, Zhaoyang, et al.
Pubblicazione: (2024)
RHS-TRNG: A Resilient High-Speed True Random Number Generator Based on STT-MTJ Device
di: Fu, Siqing, et al.
Pubblicazione: (2023)
di: Fu, Siqing, et al.
Pubblicazione: (2023)
Documenti analoghi
-
PrefixAgent: An LLM-Powered Design Framework for Efficient Prefix Adder Optimization
di: Zuo, Dongsheng, et al.
Pubblicazione: (2025) -
Online Alignment and Addition in Multi-Term Floating-Point Adders
di: Alexandridis, Kosmas, et al.
Pubblicazione: (2024) -
Floating Point HUB Adder for RISC-V Sargantana Processor
di: Bandera, Gerardo, et al.
Pubblicazione: (2024) -
Masala-CHAI: A Large-Scale SPICE Netlist Dataset for Analog Circuits by Harnessing AI
di: Bhandari, Jitendra, et al.
Pubblicazione: (2024) -
Orthrus: Dual-Loop Automated Framework for System-Technology Co-Optimization
di: Ren, Yi, et al.
Pubblicazione: (2025)