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Procesador de números complejos enteros de alta velocidad implementada en un FPGA

Fuente: Redalyc

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Dettagli Bibliografici
Autore principale:	Julio César Sosa-Savedra
Natura:	Artículo científico
Lingua:	es
Pubblicazione:	Universidad Nacional Autónoma de México 2018
Soggetti:	Ingeniería DSP FPGA aritmética arquitectura alta velocidad
Accesso online:	Acceder al recurso 1 Acceder al recurso 2 Acceder al recurso 3 Acceder al recurso 4 Acceder al recurso 5
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