Propuesta de diseño de un coprocesador aritmético
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Redalyc
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| Main Author: | |
|---|---|
| Format: | Artículo científico |
| Language: | es |
| Published: |
Instituto Tecnológico de Aguascalientes
2000
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| Subjects: | |
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| _version_ | 1876458883965255680 |
|---|---|
| author | J.J. López Villalobos |
| author_facet | J.J. López Villalobos |
| contents | Propuesta de diseño de un coprocesador aritmético J.J. López Villalobos R. Mata Vázquez Ingeniería codiseño diseño digital sumadores aritméticos multiplicadores aritméticos En este trabajo se presenta una propuesta dediseño de una arquitectura para procesosaritméticos y el uso de interfaces de comunicaciónhacia un bus PCI, analizados desde una perspectivade integración de todos los componentes que laconforman. Se involucra el uso de herramientasCAD, dando énfasis a la interoperabilidad de todoslos componentes del sistema mediante subsistemasde comunicación. Se propone el uso de unaarquitectura para el procesamiento aritmético lacual se basa en la mezcla de módulos de algoritmosde multiplicación y acumulación (MAC) yestructuras combinacionales, analizándolas encuanto a su desempeño y costes, formando unaarquitectura propuesta para la realización detransformada rápida de Fourier (FFT) de los datosde entrada a procesar. Su especificación esrealizada utilizando una herramienta gráfica(Ptolemy). Por otro lado, en la unidad de control sepropone el uso de un lenguaje formal (Esterel) paraespecificar máquinas de estados finitos para llevara cabo la asignación de actividades para lasoperaciones aritméticas y de comunicación externa.El campo de aplicación es el apoyo para elprocesamiento distribuido de imágenes. 2000 artículo científico 1405-5597 https://www.redalyc.org/articulo.oa?id=94401502 es http://www.redalyc.org/revista.oa?id=944 Conciencia Tecnológica application/pdf Instituto Tecnológico de Aguascalientes Conciencia Tecnológica (México) Num.15 |
| format | Artículo científico |
| id | redalyc_94401502 |
| institution | Redalyc |
| language | es |
| publishDate | 2000 |
| publisher | Instituto Tecnológico de Aguascalientes |
| spellingShingle | Propuesta de diseño de un coprocesador aritmético J.J. López Villalobos Ingeniería codiseño diseño digital sumadores aritméticos multiplicadores aritméticos Propuesta de diseño de un coprocesador aritmético J.J. López Villalobos R. Mata Vázquez Ingeniería codiseño diseño digital sumadores aritméticos multiplicadores aritméticos En este trabajo se presenta una propuesta dediseño de una arquitectura para procesosaritméticos y el uso de interfaces de comunicaciónhacia un bus PCI, analizados desde una perspectivade integración de todos los componentes que laconforman. Se involucra el uso de herramientasCAD, dando énfasis a la interoperabilidad de todoslos componentes del sistema mediante subsistemasde comunicación. Se propone el uso de unaarquitectura para el procesamiento aritmético lacual se basa en la mezcla de módulos de algoritmosde multiplicación y acumulación (MAC) yestructuras combinacionales, analizándolas encuanto a su desempeño y costes, formando unaarquitectura propuesta para la realización detransformada rápida de Fourier (FFT) de los datosde entrada a procesar. Su especificación esrealizada utilizando una herramienta gráfica(Ptolemy). Por otro lado, en la unidad de control sepropone el uso de un lenguaje formal (Esterel) paraespecificar máquinas de estados finitos para llevara cabo la asignación de actividades para lasoperaciones aritméticas y de comunicación externa.El campo de aplicación es el apoyo para elprocesamiento distribuido de imágenes. 2000 artículo científico 1405-5597 https://www.redalyc.org/articulo.oa?id=94401502 es http://www.redalyc.org/revista.oa?id=944 Conciencia Tecnológica application/pdf Instituto Tecnológico de Aguascalientes Conciencia Tecnológica (México) Num.15 |
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| topic | Ingeniería codiseño diseño digital sumadores aritméticos multiplicadores aritméticos |
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