A survey on AI-augmented Secure RTL design for hardware trojan prevention
Fuente:
Zenodo
Guardado en:
| Autores principales: | Parikh, Raj, Parikh, Khushi |
|---|---|
| Formato: | Recurso digital |
| Lenguaje: | inglés |
| Publicado: |
Zenodo
2025
|
| Materias: | |
| Acceso en línea: | |
| Etiquetas: |
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