Hardware-accelerated event-graph neural networks for low-latency time-series classification on SoC FPGA

Fuente: Zenodo
Salvato in:
Dettagli Bibliografici
Autore principale: Wzorek, Piotr
Natura: Recurso digital
Pubblicazione: Zenodo 2025
Accesso online:
Tags: Aggiungi Tag
Nessun Tag, puoi essere il primo ad aggiungerne!!