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Optimizing Digital Signal Processing with Half-Precision Floating-Point Arithmetic

Fuente: Zenodo

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Dettagli Bibliografici
Autore principale:	Dr. Elianore Quasar and Dr. Kaia Rykhard
Natura:	Recurso digital
Pubblicazione:	Zenodo 2019
Soggetti:	Half precision IEEE754 floating point Multiplier adder subtractor QuartusII Verilog hardware descriptive language (HDL).
Accesso online:	Acceder al recurso
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